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メモリインタリーブとは?めもりいんたりーぶ

メモリインタリーブとは、主記憶を複数のバンクに分け、連続するアドレスを別々のバンクへ順番に割り当てる高速化技法。あるバンクが読出し動作を終えるのを待つ間に次のバンクへ要求を出せるので、待ち時間が重なり合って実効的な転送速度が上がる。分割数に応じて2ウェイ・4ウェイなどと呼ぶ。

最終更新:2026-10-07

試験情報

高度試験・午前I(全区分共通)の過去問では3回出題されています(2016年度〜2020年度)。

高度試験・午前I(全区分共通)の頻出用語/午前I(全区分共通)

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背景

CPUの動作速度がDRAMの読出し時間より速くなり、アクセスのたびに待たされることが性能の頭打ちになった。素子1つを速くするのは難しいので、同じ速度の素子を並べて同時に動かし、待ち時間を重ねて見かけ上短くする発想が採られた。よく使うデータを手元に置くキャッシュメモリとは狙いが違い、こちらは主記憶そのものの実効速度を上げる。

具体例

4バンク構成なら、連続する4語ぶんの要求を4つのバンクへ同時に投げられるため、連続した領域の読出しは理論上4倍まで速くなる。DDR SDRAMを2枚・4枚組で使うデュアルチャネル、クアッドチャネル構成も同じ考え方に立つ。

試験での引っ掛け

効果が出るのは連続アドレスへ順に読み書きする場合で、ランダムアクセスでは同じバンクへ続けて当たることが多く、効果は薄い。バンク数を増やせば常に速くなるわけではない点が問われる。

関連用語

出た過去問

解説は資格暗記が独自に作成しています。過去問の出典は各問題に記載のとおりです。

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試験での特徴
  • 試験では3回出題(2016年度〜2020年度)
  • 分野:午前I(全区分共通)
  • 効果が出るのは連続アドレスへ順に読み書きする場合で、ランダムアクセスでは同じバンクへ続けて当たることが多く、効果は薄い。