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クロックゲーティングとは?くろっくげーてぃんぐ

クロックゲーティングとは、使っていない回路ブロックへのクロック供給を止め、信号が遷移しないようにして動的消費電力を削る手法。電源もフリップフロップの内容も保たれたままなので、クロックを再供給すれば数サイクルで元の動作へ戻れる。論理としては許可信号とクロックの論理積だが、実装ではひげを出さない専用のゲーティングセルを使う。

最終更新:2026-10-06

試験情報

エンベデッドシステムスペシャリスト試験の過去問では2問の解説で触れられています(2019年度〜2021年度)。

エンベデッドシステムスペシャリスト試験の頻出用語/午前II

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背景

CMOS回路の動的消費電力はトグル率×容量×電圧の2乗×周波数で決まり、動いていないブロックでもクロックが届いていればクロックツリーとフリップフロップが毎サイクル充放電を続ける。電池駆動の機器では、この取りこぼしを潰すのが最も安く効く。低消費電力設計は削減量と復帰時間のトレードオフで段階が分かれており、この手法は復帰が速い側の入口にあたる。

具体例

NXPやSTのMCUは周辺機能ごとにクロック許可ビットを持ち、使わないSPIやADCへの供給を止められる。リセット直後は多くの周辺がクロック停止状態なので、初期化で許可ビットを立て忘れるとレジスタに書いても値が入らない。

試験での引っ掛け

リーク電流の削減と混同しない。クロックを止めても電源は入ったままなので漏れ電流は残る。電源そのものを落として漏れまで断つのがパワーゲーティングで、こちらはレジスタ内容が失われ、復帰にも時間がかかる。

関連用語

出た過去問

解説は資格暗記が独自に作成しています。過去問の出典は各問題に記載のとおりです。

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試験での特徴
  • 2問の解説で触れられる(2019年度〜2021年度)
  • 分野:午前II
  • リーク電流の削減と混同しない。